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串行通信系統(tǒng)接口模塊的設(shè)計(jì)與優(yōu)化

串行通信系統(tǒng)接口模塊的設(shè)計(jì)與優(yōu)化

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簡(jiǎn)介:

串行通信系統(tǒng)以硬件資源簡(jiǎn)單、抗干擾強(qiáng)、易于實(shí)現(xiàn)等特點(diǎn)在數(shù)據(jù)通信及控制系統(tǒng)中得到了廣泛的運(yùn)用。本文以FPGA為實(shí)現(xiàn)平臺(tái),基于UART16550通信協(xié)議及工作原理完成高性能串行通信系統(tǒng)接口模塊的完整功能設(shè)計(jì)與優(yōu)化。采用三段式狀態(tài)機(jī)設(shè)計(jì)方法和EDA優(yōu)化、電路優(yōu)化等優(yōu)化手段完成設(shè)計(jì)及優(yōu)化。優(yōu)化后的設(shè)計(jì)系統(tǒng)時(shí)鐘頻率最高達(dá)到166 MHz,功耗降低了63.9%,達(dá)到0.147 W,且給出了典型波特率115200下的板級(jí)測(cè)試數(shù)據(jù)和Matlab分析結(jié)果。實(shí)驗(yàn)結(jié)果證明功能正確且穩(wěn)定可靠。

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